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1225TimeQuest Timing Analyzer report for fakequidditch
Sat May 25 01:40:48 2019
Quartus II 64-Bit Version 13.1.0 Build 162 10/23/2013 SJ Web Edition
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. TimeQuest Timing Analyzer Summary
3. Parallel Compilation
4. Clocks
5. Slow 1100mV 85C Model Fmax Summary
6. Timing Closure Recommendations
7. Slow 1100mV 85C Model Setup Summary
8. Slow 1100mV 85C Model Hold Summary
9. Slow 1100mV 85C Model Recovery Summary
10. Slow 1100mV 85C Model Removal Summary
11. Slow 1100mV 85C Model Minimum Pulse Width Summary
12. Setup Times
13. Hold Times
14. Clock to Output Times
15. Minimum Clock to Output Times
16. Slow 1100mV 85C Model Metastability Report
17. Slow 1100mV 0C Model Fmax Summary
18. Slow 1100mV 0C Model Setup Summary
19. Slow 1100mV 0C Model Hold Summary
20. Slow 1100mV 0C Model Recovery Summary
21. Slow 1100mV 0C Model Removal Summary
22. Slow 1100mV 0C Model Minimum Pulse Width Summary
23. Setup Times
24. Hold Times
25. Clock to Output Times
26. Minimum Clock to Output Times
27. Slow 1100mV 0C Model Metastability Report
28. Fast 1100mV 85C Model Setup Summary
29. Fast 1100mV 85C Model Hold Summary
30. Fast 1100mV 85C Model Recovery Summary
31. Fast 1100mV 85C Model Removal Summary
32. Fast 1100mV 85C Model Minimum Pulse Width Summary
33. Setup Times
34. Hold Times
35. Clock to Output Times
36. Minimum Clock to Output Times
37. Fast 1100mV 85C Model Metastability Report
38. Fast 1100mV 0C Model Setup Summary
39. Fast 1100mV 0C Model Hold Summary
40. Fast 1100mV 0C Model Recovery Summary
41. Fast 1100mV 0C Model Removal Summary
42. Fast 1100mV 0C Model Minimum Pulse Width Summary
43. Setup Times
44. Hold Times
45. Clock to Output Times
46. Minimum Clock to Output Times
47. Fast 1100mV 0C Model Metastability Report
48. Multicorner Timing Analysis Summary
49. Setup Times
50. Hold Times
51. Clock to Output Times
52. Minimum Clock to Output Times
53. Board Trace Model Assignments
54. Input Transition Times
55. Signal Integrity Metrics (Slow 1100mv 0c Model)
56. Signal Integrity Metrics (Slow 1100mv 85c Model)
57. Signal Integrity Metrics (Fast 1100mv 0c Model)
58. Signal Integrity Metrics (Fast 1100mv 85c Model)
59. Setup Transfers
60. Hold Transfers
61. Report TCCS
62. Report RSKM
63. Unconstrained Paths
64. TimeQuest Timing Analyzer Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2013 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
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Subscription Agreement, Altera MegaCore Function License
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without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
Altera or its authorized distributors. Please refer to the
applicable agreement for further details.
+-------------------------------------------------------------------------+
; TimeQuest Timing Analyzer Summary ;
+--------------------+----------------------------------------------------+
; Quartus II Version ; Version 13.1.0 Build 162 10/23/2013 SJ Web Edition ;
; Revision Name ; fakequidditch ;
; Device Family ; Cyclone V ;
; Device Name ; 5CSEMA5F31C6 ;
; Timing Models ; Preliminary ;
; Delay Model ; Combined ;
; Rise/Fall Delays ; Enabled ;
+--------------------+----------------------------------------------------+
+------------------------------------------+
; Parallel Compilation ;
+----------------------------+-------------+
; Processors ; Number ;
+----------------------------+-------------+
; Number detected on machine ; 4 ;
; Maximum allowed ; 2 ;
; ; ;
; Average used ; 1.48 ;
; Maximum used ; 2 ;
; ; ;
; Usage by Processor ; % Time Used ;
; Processor 1 ; 100.0% ;
; Processor 2 ; 47.8% ;
; Processors 3-4 ; 0.0% ;
+----------------------------+-------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clocks ;
+-----------------------------------------------------------------------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------------------------------------------------------------------------------+
; Clock Name ; Type ; Period ; Frequency ; Rise ; Fall ; Duty Cycle ; Divide by ; Multiply by ; Phase ; Offset ; Edge List ; Edge Shift ; Inverted ; Master ; Source ; Targets ;
+-----------------------------------------------------------------------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------------------------------------------------------------------------------+
; clk ; Base ; 1.000 ; 1000.0 MHz ; 0.000 ; 0.500 ; ; ; ; ; ; ; ; ; ; ; { clk } ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; Base ; 1.000 ; 1000.0 MHz ; 0.000 ; 0.500 ; ; ; ; ; ; ; ; ; ; ; { game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] } ;
+-----------------------------------------------------------------------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------------------------------------------------------------------------------+
+-------------------------------------------------+
; Slow 1100mV 85C Model Fmax Summary ;
+-----------+-----------------+------------+------+
; Fmax ; Restricted Fmax ; Clock Name ; Note ;
+-----------+-----------------+------------+------+
; 58.46 MHz ; 58.46 MHz ; clk ; ;
+-----------+-----------------+------------+------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods. FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock. Paths of different clocks, including generated clocks, are ignored. For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.
----------------------------------
; Timing Closure Recommendations ;
----------------------------------
HTML report is unavailable in plain text report export.
+-------------------------------------------------------------------------------------------------------+
; Slow 1100mV 85C Model Setup Summary ;
+-----------------------------------------------------------------------------+---------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+---------+---------------+
; clk ; -16.105 ; -1932.832 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; -5.520 ; -57.324 ;
+-----------------------------------------------------------------------------+---------+---------------+
+------------------------------------------------------------------------------------------------------+
; Slow 1100mV 85C Model Hold Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -0.882 ; -24.348 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 3.633 ; 0.000 ;
+-----------------------------------------------------------------------------+--------+---------------+
------------------------------------------
; Slow 1100mV 85C Model Recovery Summary ;
------------------------------------------
No paths to report.
-----------------------------------------
; Slow 1100mV 85C Model Removal Summary ;
-----------------------------------------
No paths to report.
+------------------------------------------------------------------------------------------------------+
; Slow 1100mV 85C Model Minimum Pulse Width Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -0.394 ; -169.274 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 0.092 ; 0.000 ;
+-----------------------------------------------------------------------------+--------+---------------+
+-----------------------------------------------------------------------------+
; Setup Times ;
+-----------------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+-------+-------+------------+-----------------+
; team1_vd_button ; clk ; 2.361 ; 3.162 ; Rise ; clk ;
; team1_vu_button ; clk ; 2.262 ; 3.119 ; Rise ; clk ;
; team2_vd_button ; clk ; 2.919 ; 3.891 ; Rise ; clk ;
; team2_vu_button ; clk ; 2.199 ; 3.010 ; Rise ; clk ;
+-----------------+------------+-------+-------+------------+-----------------+
+-------------------------------------------------------------------------------+
; Hold Times ;
+-----------------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+--------+--------+------------+-----------------+
; team1_vd_button ; clk ; 0.068 ; -0.495 ; Rise ; clk ;
; team1_vu_button ; clk ; 0.378 ; -0.197 ; Rise ; clk ;
; team2_vd_button ; clk ; -0.451 ; -1.072 ; Rise ; clk ;
; team2_vu_button ; clk ; -0.009 ; -0.606 ; Rise ; clk ;
+-----------------+------------+--------+--------+------------+-----------------+
+-------------------------------------------------------------------------+
; Clock to Output Times ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; blue[*] ; clk ; 11.937 ; 13.578 ; Rise ; clk ;
; blue[0] ; clk ; 11.817 ; 13.346 ; Rise ; clk ;
; blue[1] ; clk ; 11.937 ; 13.578 ; Rise ; clk ;
; blue[2] ; clk ; 11.423 ; 12.855 ; Rise ; clk ;
; blue[3] ; clk ; 10.445 ; 10.998 ; Rise ; clk ;
; blue[4] ; clk ; 10.048 ; 10.631 ; Rise ; clk ;
; blue[5] ; clk ; 10.799 ; 11.442 ; Rise ; clk ;
; blue[6] ; clk ; 11.850 ; 13.480 ; Rise ; clk ;
; blue[7] ; clk ; 11.861 ; 13.322 ; Rise ; clk ;
; green[*] ; clk ; 11.953 ; 13.433 ; Rise ; clk ;
; green[0] ; clk ; 10.139 ; 10.597 ; Rise ; clk ;
; green[1] ; clk ; 11.720 ; 13.085 ; Rise ; clk ;
; green[2] ; clk ; 11.406 ; 12.776 ; Rise ; clk ;
; green[3] ; clk ; 11.693 ; 13.075 ; Rise ; clk ;
; green[4] ; clk ; 11.953 ; 13.433 ; Rise ; clk ;
; green[5] ; clk ; 11.075 ; 12.195 ; Rise ; clk ;
; green[6] ; clk ; 11.518 ; 12.945 ; Rise ; clk ;
; green[7] ; clk ; 11.539 ; 12.816 ; Rise ; clk ;
; hor_sync ; clk ; 13.018 ; 15.027 ; Rise ; clk ;
; red[*] ; clk ; 11.336 ; 12.578 ; Rise ; clk ;
; red[0] ; clk ; 10.764 ; 11.819 ; Rise ; clk ;
; red[1] ; clk ; 10.091 ; 10.944 ; Rise ; clk ;
; red[2] ; clk ; 10.812 ; 11.853 ; Rise ; clk ;
; red[3] ; clk ; 10.698 ; 11.811 ; Rise ; clk ;
; red[4] ; clk ; 10.927 ; 12.109 ; Rise ; clk ;
; red[5] ; clk ; 11.336 ; 12.578 ; Rise ; clk ;
; red[6] ; clk ; 10.123 ; 10.591 ; Rise ; clk ;
; red[7] ; clk ; 10.813 ; 11.879 ; Rise ; clk ;
; ver_sync ; clk ; 14.318 ; 16.232 ; Rise ; clk ;
; vga_clk ; clk ; 8.545 ; 8.852 ; Rise ; clk ;
+-----------+------------+--------+--------+------------+-----------------+
+-------------------------------------------------------------------------+
; Minimum Clock to Output Times ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; blue[*] ; clk ; 9.438 ; 9.932 ; Rise ; clk ;
; blue[0] ; clk ; 11.012 ; 12.291 ; Rise ; clk ;
; blue[1] ; clk ; 11.164 ; 12.622 ; Rise ; clk ;
; blue[2] ; clk ; 10.699 ; 11.976 ; Rise ; clk ;
; blue[3] ; clk ; 9.805 ; 10.295 ; Rise ; clk ;
; blue[4] ; clk ; 9.438 ; 9.932 ; Rise ; clk ;
; blue[5] ; clk ; 10.097 ; 10.619 ; Rise ; clk ;
; blue[6] ; clk ; 11.028 ; 12.382 ; Rise ; clk ;
; blue[7] ; clk ; 11.065 ; 12.311 ; Rise ; clk ;
; green[*] ; clk ; 9.517 ; 9.878 ; Rise ; clk ;
; green[0] ; clk ; 9.517 ; 9.878 ; Rise ; clk ;
; green[1] ; clk ; 10.946 ; 12.114 ; Rise ; clk ;
; green[2] ; clk ; 10.665 ; 11.850 ; Rise ; clk ;
; green[3] ; clk ; 10.909 ; 12.090 ; Rise ; clk ;
; green[4] ; clk ; 11.129 ; 12.360 ; Rise ; clk ;
; green[5] ; clk ; 10.378 ; 11.365 ; Rise ; clk ;
; green[6] ; clk ; 10.767 ; 12.001 ; Rise ; clk ;
; green[7] ; clk ; 10.781 ; 11.890 ; Rise ; clk ;
; hor_sync ; clk ; 11.596 ; 13.146 ; Rise ; clk ;
; red[*] ; clk ; 9.497 ; 9.886 ; Rise ; clk ;
; red[0] ; clk ; 10.075 ; 10.950 ; Rise ; clk ;
; red[1] ; clk ; 9.497 ; 10.262 ; Rise ; clk ;
; red[2] ; clk ; 10.155 ; 11.089 ; Rise ; clk ;
; red[3] ; clk ; 10.043 ; 11.037 ; Rise ; clk ;
; red[4] ; clk ; 10.266 ; 11.327 ; Rise ; clk ;
; red[5] ; clk ; 10.624 ; 11.723 ; Rise ; clk ;
; red[6] ; clk ; 9.497 ; 9.886 ; Rise ; clk ;
; red[7] ; clk ; 10.138 ; 11.086 ; Rise ; clk ;
; ver_sync ; clk ; 12.115 ; 13.549 ; Rise ; clk ;
; vga_clk ; clk ; 8.065 ; 8.274 ; Rise ; clk ;
+-----------+------------+--------+--------+------------+-----------------+
----------------------------------------------
; Slow 1100mV 85C Model Metastability Report ;
----------------------------------------------
No synchronizer chains to report.
+-------------------------------------------------+
; Slow 1100mV 0C Model Fmax Summary ;
+-----------+-----------------+------------+------+
; Fmax ; Restricted Fmax ; Clock Name ; Note ;
+-----------+-----------------+------------+------+
; 57.53 MHz ; 57.53 MHz ; clk ; ;
+-----------+-----------------+------------+------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods. FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock. Paths of different clocks, including generated clocks, are ignored. For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.
+-------------------------------------------------------------------------------------------------------+
; Slow 1100mV 0C Model Setup Summary ;
+-----------------------------------------------------------------------------+---------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+---------+---------------+
; clk ; -16.381 ; -1933.068 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; -5.642 ; -58.283 ;
+-----------------------------------------------------------------------------+---------+---------------+
+------------------------------------------------------------------------------------------------------+
; Slow 1100mV 0C Model Hold Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -0.978 ; -26.480 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 3.650 ; 0.000 ;
+-----------------------------------------------------------------------------+--------+---------------+
-----------------------------------------
; Slow 1100mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.
----------------------------------------
; Slow 1100mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.
+------------------------------------------------------------------------------------------------------+
; Slow 1100mV 0C Model Minimum Pulse Width Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -0.394 ; -187.268 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 0.099 ; 0.000 ;
+-----------------------------------------------------------------------------+--------+---------------+
+-----------------------------------------------------------------------------+
; Setup Times ;
+-----------------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+-------+-------+------------+-----------------+
; team1_vd_button ; clk ; 2.053 ; 2.935 ; Rise ; clk ;
; team1_vu_button ; clk ; 1.966 ; 2.877 ; Rise ; clk ;
; team2_vd_button ; clk ; 2.703 ; 3.724 ; Rise ; clk ;
; team2_vu_button ; clk ; 1.872 ; 2.762 ; Rise ; clk ;
+-----------------+------------+-------+-------+------------+-----------------+
+-------------------------------------------------------------------------------+
; Hold Times ;
+-----------------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+--------+--------+------------+-----------------+
; team1_vd_button ; clk ; 0.304 ; -0.260 ; Rise ; clk ;
; team1_vu_button ; clk ; 0.620 ; 0.059 ; Rise ; clk ;
; team2_vd_button ; clk ; -0.281 ; -0.896 ; Rise ; clk ;
; team2_vu_button ; clk ; 0.244 ; -0.350 ; Rise ; clk ;
+-----------------+------------+--------+--------+------------+-----------------+
+-------------------------------------------------------------------------+
; Clock to Output Times ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; blue[*] ; clk ; 11.863 ; 13.580 ; Rise ; clk ;
; blue[0] ; clk ; 11.654 ; 13.270 ; Rise ; clk ;
; blue[1] ; clk ; 11.863 ; 13.580 ; Rise ; clk ;
; blue[2] ; clk ; 11.311 ; 12.823 ; Rise ; clk ;
; blue[3] ; clk ; 10.107 ; 10.734 ; Rise ; clk ;
; blue[4] ; clk ; 9.696 ; 10.333 ; Rise ; clk ;
; blue[5] ; clk ; 10.440 ; 11.171 ; Rise ; clk ;
; blue[6] ; clk ; 11.724 ; 13.444 ; Rise ; clk ;
; blue[7] ; clk ; 11.693 ; 13.237 ; Rise ; clk ;
; green[*] ; clk ; 11.828 ; 13.419 ; Rise ; clk ;
; green[0] ; clk ; 9.787 ; 10.329 ; Rise ; clk ;
; green[1] ; clk ; 11.578 ; 13.050 ; Rise ; clk ;
; green[2] ; clk ; 11.307 ; 12.762 ; Rise ; clk ;
; green[3] ; clk ; 11.605 ; 13.083 ; Rise ; clk ;
; green[4] ; clk ; 11.828 ; 13.419 ; Rise ; clk ;
; green[5] ; clk ; 10.898 ; 12.130 ; Rise ; clk ;
; green[6] ; clk ; 11.439 ; 12.930 ; Rise ; clk ;
; green[7] ; clk ; 11.397 ; 12.785 ; Rise ; clk ;
; hor_sync ; clk ; 12.944 ; 15.065 ; Rise ; clk ;
; red[*] ; clk ; 11.225 ; 12.549 ; Rise ; clk ;
; red[0] ; clk ; 10.512 ; 11.678 ; Rise ; clk ;
; red[1] ; clk ; 9.925 ; 10.835 ; Rise ; clk ;
; red[2] ; clk ; 10.663 ; 11.808 ; Rise ; clk ;
; red[3] ; clk ; 10.579 ; 11.783 ; Rise ; clk ;
; red[4] ; clk ; 10.803 ; 12.083 ; Rise ; clk ;
; red[5] ; clk ; 11.225 ; 12.549 ; Rise ; clk ;
; red[6] ; clk ; 9.805 ; 10.345 ; Rise ; clk ;
; red[7] ; clk ; 10.673 ; 11.837 ; Rise ; clk ;
; ver_sync ; clk ; 14.265 ; 16.304 ; Rise ; clk ;
; vga_clk ; clk ; 8.351 ; 8.721 ; Rise ; clk ;
+-----------+------------+--------+--------+------------+-----------------+
+-------------------------------------------------------------------------+
; Minimum Clock to Output Times ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; blue[*] ; clk ; 9.124 ; 9.635 ; Rise ; clk ;
; blue[0] ; clk ; 10.864 ; 12.193 ; Rise ; clk ;
; blue[1] ; clk ; 11.098 ; 12.589 ; Rise ; clk ;
; blue[2] ; clk ; 10.602 ; 11.917 ; Rise ; clk ;
; blue[3] ; clk ; 9.500 ; 10.011 ; Rise ; clk ;
; blue[4] ; clk ; 9.124 ; 9.635 ; Rise ; clk ;
; blue[5] ; clk ; 9.776 ; 10.336 ; Rise ; clk ;
; blue[6] ; clk ; 10.915 ; 12.317 ; Rise ; clk ;
; blue[7] ; clk ; 10.914 ; 12.210 ; Rise ; clk ;
; green[*] ; clk ; 9.202 ; 9.628 ; Rise ; clk ;
; green[0] ; clk ; 9.202 ; 9.628 ; Rise ; clk ;
; green[1] ; clk ; 10.822 ; 12.078 ; Rise ; clk ;
; green[2] ; clk ; 10.579 ; 11.829 ; Rise ; clk ;
; green[3] ; clk ; 10.831 ; 12.064 ; Rise ; clk ;
; green[4] ; clk ; 11.018 ; 12.353 ; Rise ; clk ;
; green[5] ; clk ; 10.224 ; 11.290 ; Rise ; clk ;
; green[6] ; clk ; 10.700 ; 11.980 ; Rise ; clk ;
; green[7] ; clk ; 10.657 ; 11.842 ; Rise ; clk ;
; hor_sync ; clk ; 11.556 ; 13.130 ; Rise ; clk ;
; red[*] ; clk ; 9.214 ; 9.632 ; Rise ; clk ;
; red[0] ; clk ; 9.849 ; 10.823 ; Rise ; clk ;
; red[1] ; clk ; 9.351 ; 10.143 ; Rise ; clk ;
; red[2] ; clk ; 10.023 ; 11.027 ; Rise ; clk ;
; red[3] ; clk ; 9.940 ; 10.988 ; Rise ; clk ;
; red[4] ; clk ; 10.154 ; 11.279 ; Rise ; clk ;
; red[5] ; clk ; 10.525 ; 11.675 ; Rise ; clk ;
; red[6] ; clk ; 9.214 ; 9.632 ; Rise ; clk ;
; red[7] ; clk ; 10.018 ; 11.031 ; Rise ; clk ;
; ver_sync ; clk ; 12.023 ; 13.507 ; Rise ; clk ;
; vga_clk ; clk ; 7.893 ; 8.176 ; Rise ; clk ;
+-----------+------------+--------+--------+------------+-----------------+
---------------------------------------------
; Slow 1100mV 0C Model Metastability Report ;
---------------------------------------------
No synchronizer chains to report.
+------------------------------------------------------------------------------------------------------+
; Fast 1100mV 85C Model Setup Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -9.221 ; -988.400 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; -2.732 ; -26.176 ;
+-----------------------------------------------------------------------------+--------+---------------+
+------------------------------------------------------------------------------------------------------+
; Fast 1100mV 85C Model Hold Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -0.451 ; -6.894 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 1.955 ; 0.000 ;
+-----------------------------------------------------------------------------+--------+---------------+
------------------------------------------
; Fast 1100mV 85C Model Recovery Summary ;
------------------------------------------
No paths to report.
-----------------------------------------
; Fast 1100mV 85C Model Removal Summary ;
-----------------------------------------
No paths to report.
+------------------------------------------------------------------------------------------------------+
; Fast 1100mV 85C Model Minimum Pulse Width Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -0.088 ; -26.697 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 0.176 ; 0.000 ;
+-----------------------------------------------------------------------------+--------+---------------+
+-----------------------------------------------------------------------------+
; Setup Times ;
+-----------------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+-------+-------+------------+-----------------+
; team1_vd_button ; clk ; 1.301 ; 2.299 ; Rise ; clk ;
; team1_vu_button ; clk ; 1.266 ; 2.301 ; Rise ; clk ;
; team2_vd_button ; clk ; 1.677 ; 2.827 ; Rise ; clk ;
; team2_vu_button ; clk ; 1.190 ; 2.159 ; Rise ; clk ;
+-----------------+------------+-------+-------+------------+-----------------+
+-------------------------------------------------------------------------------+
; Hold Times ;
+-----------------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+--------+--------+------------+-----------------+
; team1_vd_button ; clk ; 0.027 ; -0.742 ; Rise ; clk ;
; team1_vu_button ; clk ; 0.182 ; -0.569 ; Rise ; clk ;
; team2_vd_button ; clk ; -0.389 ; -1.209 ; Rise ; clk ;
; team2_vu_button ; clk ; -0.100 ; -0.891 ; Rise ; clk ;
+-----------------+------------+--------+--------+------------+-----------------+
+------------------------------------------------------------------------+
; Clock to Output Times ;
+-----------+------------+-------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+--------+------------+-----------------+
; blue[*] ; clk ; 7.573 ; 9.103 ; Rise ; clk ;
; blue[0] ; clk ; 7.381 ; 8.775 ; Rise ; clk ;
; blue[1] ; clk ; 7.573 ; 9.103 ; Rise ; clk ;
; blue[2] ; clk ; 7.177 ; 8.530 ; Rise ; clk ;
; blue[3] ; clk ; 6.249 ; 6.831 ; Rise ; clk ;
; blue[4] ; clk ; 5.970 ; 6.571 ; Rise ; clk ;
; blue[5] ; clk ; 6.448 ; 7.139 ; Rise ; clk ;
; blue[6] ; clk ; 7.445 ; 8.932 ; Rise ; clk ;
; blue[7] ; clk ; 7.404 ; 8.762 ; Rise ; clk ;
; green[*] ; clk ; 7.514 ; 8.931 ; Rise ; clk ;
; green[0] ; clk ; 6.027 ; 6.544 ; Rise ; clk ;
; green[1] ; clk ; 7.319 ; 8.666 ; Rise ; clk ;
; green[2] ; clk ; 7.185 ; 8.486 ; Rise ; clk ;
; green[3] ; clk ; 7.362 ; 8.706 ; Rise ; clk ;
; green[4] ; clk ; 7.514 ; 8.931 ; Rise ; clk ;
; green[5] ; clk ; 6.825 ; 7.954 ; Rise ; clk ;
; green[6] ; clk ; 7.257 ; 8.615 ; Rise ; clk ;
; green[7] ; clk ; 7.227 ; 8.471 ; Rise ; clk ;
; hor_sync ; clk ; 8.211 ; 10.035 ; Rise ; clk ;
; red[*] ; clk ; 7.084 ; 8.295 ; Rise ; clk ;
; red[0] ; clk ; 6.556 ; 7.557 ; Rise ; clk ;
; red[1] ; clk ; 6.175 ; 7.024 ; Rise ; clk ;
; red[2] ; clk ; 6.687 ; 7.719 ; Rise ; clk ;
; red[3] ; clk ; 6.667 ; 7.735 ; Rise ; clk ;
; red[4] ; clk ; 6.786 ; 7.920 ; Rise ; clk ;
; red[5] ; clk ; 7.084 ; 8.295 ; Rise ; clk ;
; red[6] ; clk ; 6.054 ; 6.601 ; Rise ; clk ;
; red[7] ; clk ; 6.659 ; 7.729 ; Rise ; clk ;
; ver_sync ; clk ; 8.845 ; 10.682 ; Rise ; clk ;
; vga_clk ; clk ; 5.079 ; 5.422 ; Rise ; clk ;
+-----------+------------+-------+--------+------------+-----------------+
+-----------------------------------------------------------------------+
; Minimum Clock to Output Times ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; blue[*] ; clk ; 5.660 ; 6.189 ; Rise ; clk ;
; blue[0] ; clk ; 6.928 ; 8.125 ; Rise ; clk ;
; blue[1] ; clk ; 7.139 ; 8.522 ; Rise ; clk ;
; blue[2] ; clk ; 6.776 ; 8.006 ; Rise ; clk ;
; blue[3] ; clk ; 5.918 ; 6.445 ; Rise ; clk ;
; blue[4] ; clk ; 5.660 ; 6.189 ; Rise ; clk ;
; blue[5] ; clk ; 6.079 ; 6.667 ; Rise ; clk ;
; blue[6] ; clk ; 6.984 ; 8.255 ; Rise ; clk ;
; blue[7] ; clk ; 6.963 ; 8.150 ; Rise ; clk ;
; green[*] ; clk ; 5.711 ; 6.150 ; Rise ; clk ;
; green[0] ; clk ; 5.711 ; 6.150 ; Rise ; clk ;
; green[1] ; clk ; 6.892 ; 8.080 ; Rise ; clk ;
; green[2] ; clk ; 6.772 ; 7.924 ; Rise ; clk ;
; green[3] ; clk ; 6.919 ; 8.098 ; Rise ; clk ;
; green[4] ; clk ; 7.049 ; 8.265 ; Rise ; clk ;
; green[5] ; clk ; 6.451 ; 7.470 ; Rise ; clk ;
; green[6] ; clk ; 6.837 ; 8.042 ; Rise ; clk ;
; green[7] ; clk ; 6.805 ; 7.909 ; Rise ; clk ;
; hor_sync ; clk ; 7.329 ; 8.722 ; Rise ; clk ;
; red[*] ; clk ; 5.727 ; 6.204 ; Rise ; clk ;
; red[0] ; clk ; 6.188 ; 7.051 ; Rise ; clk ;
; red[1] ; clk ; 5.862 ; 6.639 ; Rise ; clk ;
; red[2] ; clk ; 6.335 ; 7.280 ; Rise ; clk ;
; red[3] ; clk ; 6.312 ; 7.284 ; Rise ; clk ;
; red[4] ; clk ; 6.427 ; 7.463 ; Rise ; clk ;
; red[5] ; clk ; 6.696 ; 7.791 ; Rise ; clk ;
; red[6] ; clk ; 5.727 ; 6.204 ; Rise ; clk ;
; red[7] ; clk ; 6.297 ; 7.269 ; Rise ; clk ;
; ver_sync ; clk ; 7.661 ; 9.043 ; Rise ; clk ;
; vga_clk ; clk ; 4.833 ; 5.100 ; Rise ; clk ;
+-----------+------------+-------+-------+------------+-----------------+
----------------------------------------------
; Fast 1100mV 85C Model Metastability Report ;
----------------------------------------------
No synchronizer chains to report.
+------------------------------------------------------------------------------------------------------+
; Fast 1100mV 0C Model Setup Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -8.531 ; -896.761 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; -2.586 ; -24.703 ;
+-----------------------------------------------------------------------------+--------+---------------+
+------------------------------------------------------------------------------------------------------+
; Fast 1100mV 0C Model Hold Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -0.544 ; -8.587 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 1.894 ; 0.000 ;
+-----------------------------------------------------------------------------+--------+---------------+
-----------------------------------------
; Fast 1100mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.
----------------------------------------
; Fast 1100mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.
+------------------------------------------------------------------------------------------------------+
; Fast 1100mV 0C Model Minimum Pulse Width Summary ;
+-----------------------------------------------------------------------------+--------+---------------+
; Clock ; Slack ; End Point TNS ;
+-----------------------------------------------------------------------------+--------+---------------+
; clk ; -0.089 ; -26.949 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 0.224 ; 0.000 ;
+-----------------------------------------------------------------------------+--------+---------------+
+-----------------------------------------------------------------------------+
; Setup Times ;
+-----------------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+-------+-------+------------+-----------------+
; team1_vd_button ; clk ; 1.092 ; 2.065 ; Rise ; clk ;
; team1_vu_button ; clk ; 1.068 ; 2.058 ; Rise ; clk ;
; team2_vd_button ; clk ; 1.497 ; 2.586 ; Rise ; clk ;
; team2_vu_button ; clk ; 0.964 ; 1.920 ; Rise ; clk ;
+-----------------+------------+-------+-------+------------+-----------------+
+-------------------------------------------------------------------------------+
; Hold Times ;
+-----------------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+--------+--------+------------+-----------------+
; team1_vd_button ; clk ; 0.153 ; -0.588 ; Rise ; clk ;
; team1_vu_button ; clk ; 0.301 ; -0.422 ; Rise ; clk ;
; team2_vd_button ; clk ; -0.285 ; -1.067 ; Rise ; clk ;
; team2_vu_button ; clk ; 0.041 ; -0.727 ; Rise ; clk ;
+-----------------+------------+--------+--------+------------+-----------------+
+------------------------------------------------------------------------+
; Clock to Output Times ;
+-----------+------------+-------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+--------+------------+-----------------+
; blue[*] ; clk ; 7.272 ; 8.561 ; Rise ; clk ;
; blue[0] ; clk ; 7.050 ; 8.214 ; Rise ; clk ;
; blue[1] ; clk ; 7.272 ; 8.561 ; Rise ; clk ;
; blue[2] ; clk ; 6.865 ; 8.017 ; Rise ; clk ;
; blue[3] ; clk ; 5.779 ; 6.319 ; Rise ; clk ;
; blue[4] ; clk ; 5.505 ; 6.062 ; Rise ; clk ;
; blue[5] ; clk ; 5.949 ; 6.600 ; Rise ; clk ;
; blue[6] ; clk ; 7.114 ; 8.373 ; Rise ; clk ;
; blue[7] ; clk ; 7.033 ; 8.190 ; Rise ; clk ;
; green[*] ; clk ; 7.183 ; 8.390 ; Rise ; clk ;
; green[0] ; clk ; 5.578 ; 6.053 ; Rise ; clk ;
; green[1] ; clk ; 6.976 ; 8.139 ; Rise ; clk ;
; green[2] ; clk ; 6.882 ; 7.976 ; Rise ; clk ;
; green[3] ; clk ; 7.039 ; 8.197 ; Rise ; clk ;
; green[4] ; clk ; 7.183 ; 8.390 ; Rise ; clk ;
; green[5] ; clk ; 6.479 ; 7.465 ; Rise ; clk ;
; green[6] ; clk ; 6.948 ; 8.106 ; Rise ; clk ;
; green[7] ; clk ; 6.890 ; 7.960 ; Rise ; clk ;
; hor_sync ; clk ; 7.902 ; 9.439 ; Rise ; clk ;
; red[*] ; clk ; 6.770 ; 7.801 ; Rise ; clk ;
; red[0] ; clk ; 6.200 ; 7.048 ; Rise ; clk ;
; red[1] ; clk ; 5.856 ; 6.588 ; Rise ; clk ;
; red[2] ; clk ; 6.371 ; 7.255 ; Rise ; clk ;
; red[3] ; clk ; 6.372 ; 7.284 ; Rise ; clk ;
; red[4] ; clk ; 6.519 ; 7.464 ; Rise ; clk ;
; red[5] ; clk ; 6.770 ; 7.801 ; Rise ; clk ;
; red[6] ; clk ; 5.607 ; 6.122 ; Rise ; clk ;
; red[7] ; clk ; 6.331 ; 7.261 ; Rise ; clk ;
; ver_sync ; clk ; 8.462 ; 10.018 ; Rise ; clk ;
; vga_clk ; clk ; 4.837 ; 5.114 ; Rise ; clk ;
+-----------+------------+-------+--------+------------+-----------------+
+-----------------------------------------------------------------------+
; Minimum Clock to Output Times ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; blue[*] ; clk ; 5.222 ; 5.695 ; Rise ; clk ;
; blue[0] ; clk ; 6.615 ; 7.587 ; Rise ; clk ;
; blue[1] ; clk ; 6.853 ; 7.989 ; Rise ; clk ;
; blue[2] ; clk ; 6.480 ; 7.502 ; Rise ; clk ;
; blue[3] ; clk ; 5.475 ; 5.933 ; Rise ; clk ;
; blue[4] ; clk ; 5.222 ; 5.695 ; Rise ; clk ;
; blue[5] ; clk ; 5.609 ; 6.140 ; Rise ; clk ;
; blue[6] ; clk ; 6.670 ; 7.719 ; Rise ; clk ;
; blue[7] ; clk ; 6.611 ; 7.601 ; Rise ; clk ;
; green[*] ; clk ; 5.288 ; 5.684 ; Rise ; clk ;
; green[0] ; clk ; 5.288 ; 5.684 ; Rise ; clk ;
; green[1] ; clk ; 6.568 ; 7.585 ; Rise ; clk ;
; green[2] ; clk ; 6.485 ; 7.441 ; Rise ; clk ;
; green[3] ; clk ; 6.613 ; 7.602 ; Rise ; clk ;
; green[4] ; clk ; 6.736 ; 7.766 ; Rise ; clk ;
; green[5] ; clk ; 6.124 ; 6.998 ; Rise ; clk ;
; green[6] ; clk ; 6.544 ; 7.559 ; Rise ; clk ;
; green[7] ; clk ; 6.487 ; 7.415 ; Rise ; clk ;
; hor_sync ; clk ; 7.025 ; 8.160 ; Rise ; clk ;
; red[*] ; clk ; 5.306 ; 5.735 ; Rise ; clk ;
; red[0] ; clk ; 5.853 ; 6.577 ; Rise ; clk ;
; red[1] ; clk ; 5.557 ; 6.210 ; Rise ; clk ;
; red[2] ; clk ; 6.033 ; 6.822 ; Rise ; clk ;
; red[3] ; clk ; 6.031 ; 6.839 ; Rise ; clk ;
; red[4] ; clk ; 6.172 ; 7.012 ; Rise ; clk ;
; red[5] ; clk ; 6.396 ; 7.309 ; Rise ; clk ;
; red[6] ; clk ; 5.306 ; 5.735 ; Rise ; clk ;
; red[7] ; clk ; 5.987 ; 6.813 ; Rise ; clk ;
; ver_sync ; clk ; 7.315 ; 8.483 ; Rise ; clk ;
; vga_clk ; clk ; 4.602 ; 4.818 ; Rise ; clk ;
+-----------+------------+-------+-------+------------+-----------------+
---------------------------------------------
; Fast 1100mV 0C Model Metastability Report ;
---------------------------------------------
No synchronizer chains to report.
+-----------------------------------------------------------------------------------------------------------------------------------------------+
; Multicorner Timing Analysis Summary ;
+------------------------------------------------------------------------------+-----------+---------+----------+---------+---------------------+
; Clock ; Setup ; Hold ; Recovery ; Removal ; Minimum Pulse Width ;
+------------------------------------------------------------------------------+-----------+---------+----------+---------+---------------------+
; Worst-case Slack ; -16.381 ; -0.978 ; N/A ; N/A ; -0.394 ;
; clk ; -16.381 ; -0.978 ; N/A ; N/A ; -0.394 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; -5.642 ; 1.894 ; N/A ; N/A ; 0.092 ;
; Design-wide TNS ; -1991.351 ; -26.48 ; 0.0 ; 0.0 ; -187.268 ;
; clk ; -1933.068 ; -26.480 ; N/A ; N/A ; -187.268 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; -58.283 ; 0.000 ; N/A ; N/A ; 0.000 ;
+------------------------------------------------------------------------------+-----------+---------+----------+---------+---------------------+
+-----------------------------------------------------------------------------+
; Setup Times ;
+-----------------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+-------+-------+------------+-----------------+
; team1_vd_button ; clk ; 2.361 ; 3.162 ; Rise ; clk ;
; team1_vu_button ; clk ; 2.262 ; 3.119 ; Rise ; clk ;
; team2_vd_button ; clk ; 2.919 ; 3.891 ; Rise ; clk ;
; team2_vu_button ; clk ; 2.199 ; 3.010 ; Rise ; clk ;
+-----------------+------------+-------+-------+------------+-----------------+
+-------------------------------------------------------------------------------+
; Hold Times ;
+-----------------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------------+------------+--------+--------+------------+-----------------+
; team1_vd_button ; clk ; 0.304 ; -0.260 ; Rise ; clk ;
; team1_vu_button ; clk ; 0.620 ; 0.059 ; Rise ; clk ;
; team2_vd_button ; clk ; -0.281 ; -0.896 ; Rise ; clk ;
; team2_vu_button ; clk ; 0.244 ; -0.350 ; Rise ; clk ;
+-----------------+------------+--------+--------+------------+-----------------+
+-------------------------------------------------------------------------+
; Clock to Output Times ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; blue[*] ; clk ; 11.937 ; 13.580 ; Rise ; clk ;
; blue[0] ; clk ; 11.817 ; 13.346 ; Rise ; clk ;
; blue[1] ; clk ; 11.937 ; 13.580 ; Rise ; clk ;
; blue[2] ; clk ; 11.423 ; 12.855 ; Rise ; clk ;
; blue[3] ; clk ; 10.445 ; 10.998 ; Rise ; clk ;
; blue[4] ; clk ; 10.048 ; 10.631 ; Rise ; clk ;
; blue[5] ; clk ; 10.799 ; 11.442 ; Rise ; clk ;
; blue[6] ; clk ; 11.850 ; 13.480 ; Rise ; clk ;
; blue[7] ; clk ; 11.861 ; 13.322 ; Rise ; clk ;
; green[*] ; clk ; 11.953 ; 13.433 ; Rise ; clk ;
; green[0] ; clk ; 10.139 ; 10.597 ; Rise ; clk ;
; green[1] ; clk ; 11.720 ; 13.085 ; Rise ; clk ;
; green[2] ; clk ; 11.406 ; 12.776 ; Rise ; clk ;
; green[3] ; clk ; 11.693 ; 13.083 ; Rise ; clk ;
; green[4] ; clk ; 11.953 ; 13.433 ; Rise ; clk ;
; green[5] ; clk ; 11.075 ; 12.195 ; Rise ; clk ;
; green[6] ; clk ; 11.518 ; 12.945 ; Rise ; clk ;
; green[7] ; clk ; 11.539 ; 12.816 ; Rise ; clk ;
; hor_sync ; clk ; 13.018 ; 15.065 ; Rise ; clk ;
; red[*] ; clk ; 11.336 ; 12.578 ; Rise ; clk ;
; red[0] ; clk ; 10.764 ; 11.819 ; Rise ; clk ;
; red[1] ; clk ; 10.091 ; 10.944 ; Rise ; clk ;
; red[2] ; clk ; 10.812 ; 11.853 ; Rise ; clk ;
; red[3] ; clk ; 10.698 ; 11.811 ; Rise ; clk ;
; red[4] ; clk ; 10.927 ; 12.109 ; Rise ; clk ;
; red[5] ; clk ; 11.336 ; 12.578 ; Rise ; clk ;
; red[6] ; clk ; 10.123 ; 10.591 ; Rise ; clk ;
; red[7] ; clk ; 10.813 ; 11.879 ; Rise ; clk ;
; ver_sync ; clk ; 14.318 ; 16.304 ; Rise ; clk ;
; vga_clk ; clk ; 8.545 ; 8.852 ; Rise ; clk ;
+-----------+------------+--------+--------+------------+-----------------+
+-----------------------------------------------------------------------+
; Minimum Clock to Output Times ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise ; Fall ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; blue[*] ; clk ; 5.222 ; 5.695 ; Rise ; clk ;
; blue[0] ; clk ; 6.615 ; 7.587 ; Rise ; clk ;
; blue[1] ; clk ; 6.853 ; 7.989 ; Rise ; clk ;
; blue[2] ; clk ; 6.480 ; 7.502 ; Rise ; clk ;
; blue[3] ; clk ; 5.475 ; 5.933 ; Rise ; clk ;
; blue[4] ; clk ; 5.222 ; 5.695 ; Rise ; clk ;
; blue[5] ; clk ; 5.609 ; 6.140 ; Rise ; clk ;
; blue[6] ; clk ; 6.670 ; 7.719 ; Rise ; clk ;
; blue[7] ; clk ; 6.611 ; 7.601 ; Rise ; clk ;
; green[*] ; clk ; 5.288 ; 5.684 ; Rise ; clk ;
; green[0] ; clk ; 5.288 ; 5.684 ; Rise ; clk ;
; green[1] ; clk ; 6.568 ; 7.585 ; Rise ; clk ;
; green[2] ; clk ; 6.485 ; 7.441 ; Rise ; clk ;
; green[3] ; clk ; 6.613 ; 7.602 ; Rise ; clk ;
; green[4] ; clk ; 6.736 ; 7.766 ; Rise ; clk ;
; green[5] ; clk ; 6.124 ; 6.998 ; Rise ; clk ;
; green[6] ; clk ; 6.544 ; 7.559 ; Rise ; clk ;
; green[7] ; clk ; 6.487 ; 7.415 ; Rise ; clk ;
; hor_sync ; clk ; 7.025 ; 8.160 ; Rise ; clk ;
; red[*] ; clk ; 5.306 ; 5.735 ; Rise ; clk ;
; red[0] ; clk ; 5.853 ; 6.577 ; Rise ; clk ;
; red[1] ; clk ; 5.557 ; 6.210 ; Rise ; clk ;
; red[2] ; clk ; 6.033 ; 6.822 ; Rise ; clk ;
; red[3] ; clk ; 6.031 ; 6.839 ; Rise ; clk ;
; red[4] ; clk ; 6.172 ; 7.012 ; Rise ; clk ;
; red[5] ; clk ; 6.396 ; 7.309 ; Rise ; clk ;
; red[6] ; clk ; 5.306 ; 5.735 ; Rise ; clk ;
; red[7] ; clk ; 5.987 ; 6.813 ; Rise ; clk ;
; ver_sync ; clk ; 7.315 ; 8.483 ; Rise ; clk ;
; vga_clk ; clk ; 4.602 ; 4.818 ; Rise ; clk ;
+-----------+------------+-------+-------+------------+-----------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Board Trace Model Assignments ;
+----------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
; Pin ; I/O Standard ; Near Tline Length ; Near Tline L per Length ; Near Tline C per Length ; Near Series R ; Near Differential R ; Near Pull-up R ; Near Pull-down R ; Near C ; Far Tline Length ; Far Tline L per Length ; Far Tline C per Length ; Far Series R ; Far Pull-up R ; Far Pull-down R ; Far C ; Termination Voltage ; Far Differential R ; EBD File Name ; EBD Signal Name ; EBD Far-end ;
+----------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
; red[0] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[1] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[2] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[3] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[4] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[5] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[6] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; red[7] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[0] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[1] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[2] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[3] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[4] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[5] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[6] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; green[7] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[0] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[1] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[2] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[3] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[4] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[5] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[6] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; blue[7] ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; hor_sync ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; ver_sync ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
; vga_clk ; 2.5 V ; 0 in ; 0 H/in ; 0 F/in ; short ; - ; open ; open ; open ; 0 in ; 0 H/in ; 0 F/in ; short ; open ; open ; open ; 0 V ; - ; n/a ; n/a ; n/a ;
+----------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
+--------------------------------------------------------------------+
; Input Transition Times ;
+-----------------+--------------+-----------------+-----------------+
; Pin ; I/O Standard ; 10-90 Rise Time ; 90-10 Fall Time ;
+-----------------+--------------+-----------------+-----------------+
; clk ; 2.5 V ; 2000 ps ; 2000 ps ;
; team1_vu_button ; 2.5 V ; 2000 ps ; 2000 ps ;
; team1_vd_button ; 2.5 V ; 2000 ps ; 2000 ps ;
; team2_vu_button ; 2.5 V ; 2000 ps ; 2000 ps ;
; team2_vd_button ; 2.5 V ; 2000 ps ; 2000 ps ;
+-----------------+--------------+-----------------+-----------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Signal Integrity Metrics (Slow 1100mv 0c Model) ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; red[0] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0557 V ; 0.175 V ; 0.114 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0557 V ; 0.175 V ; 0.114 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ;
; red[1] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; red[2] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; red[3] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; red[4] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0568 V ; 0.173 V ; 0.113 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0568 V ; 0.173 V ; 0.113 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ;
; red[5] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; red[6] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; red[7] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; green[0] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; green[1] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; green[2] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; green[3] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; green[4] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; green[5] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; green[6] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; green[7] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; blue[0] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0568 V ; 0.173 V ; 0.113 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0568 V ; 0.173 V ; 0.113 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ;
; blue[1] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; blue[2] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; blue[3] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; blue[4] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; blue[5] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; blue[6] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; blue[7] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ; 2.32 V ; 3.07e-07 V ; 2.36 V ; -0.0231 V ; 0.14 V ; 0.089 V ; 4.52e-10 s ; 4.35e-10 s ; No ; Yes ;
; hor_sync ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0557 V ; 0.175 V ; 0.114 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0557 V ; 0.175 V ; 0.114 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ;
; ver_sync ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ; 2.32 V ; 3.6e-07 V ; 2.41 V ; -0.0463 V ; 0.201 V ; 0.131 V ; 4.61e-10 s ; 4.53e-10 s ; No ; Yes ;
; vga_clk ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0568 V ; 0.173 V ; 0.113 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ; 2.32 V ; 3.52e-07 V ; 2.42 V ; -0.0568 V ; 0.173 V ; 0.113 V ; 4.5e-10 s ; 4.35e-10 s ; No ; No ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Signal Integrity Metrics (Slow 1100mv 85c Model) ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; red[0] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.037 V ; 0.188 V ; 0.158 V ; 4.67e-10 s ; 4.67e-10 s ; No ; Yes ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.037 V ; 0.188 V ; 0.158 V ; 4.67e-10 s ; 4.67e-10 s ; No ; Yes ;
; red[1] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; red[2] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; red[3] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; red[4] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.0374 V ; 0.189 V ; 0.158 V ; 4.66e-10 s ; 4.67e-10 s ; No ; Yes ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.0374 V ; 0.189 V ; 0.158 V ; 4.66e-10 s ; 4.67e-10 s ; No ; Yes ;
; red[5] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; red[6] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; red[7] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; green[0] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; green[1] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; green[2] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; green[3] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; green[4] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; green[5] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; green[6] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; green[7] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; blue[0] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.0374 V ; 0.189 V ; 0.158 V ; 4.66e-10 s ; 4.67e-10 s ; No ; Yes ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.0374 V ; 0.189 V ; 0.158 V ; 4.66e-10 s ; 4.67e-10 s ; No ; Yes ;
; blue[1] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; blue[2] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; blue[3] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; blue[4] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; blue[5] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; blue[6] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; blue[7] ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ; 2.32 V ; 3.49e-05 V ; 2.34 V ; -0.0118 V ; 0.182 V ; 0.051 V ; 4.81e-10 s ; 4.83e-10 s ; Yes ; Yes ;
; hor_sync ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.037 V ; 0.188 V ; 0.158 V ; 4.67e-10 s ; 4.67e-10 s ; No ; Yes ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.037 V ; 0.188 V ; 0.158 V ; 4.67e-10 s ; 4.67e-10 s ; No ; Yes ;
; ver_sync ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ; 2.32 V ; 3.96e-05 V ; 2.38 V ; -0.0306 V ; 0.23 V ; 0.206 V ; 4.83e-10 s ; 5.01e-10 s ; No ; Yes ;
; vga_clk ; 2.5 V ; 0 s ; 0 s ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.0374 V ; 0.189 V ; 0.158 V ; 4.66e-10 s ; 4.67e-10 s ; No ; Yes ; 2.32 V ; 3.88e-05 V ; 2.39 V ; -0.0374 V ; 0.189 V ; 0.158 V ; 4.66e-10 s ; 4.67e-10 s ; No ; Yes ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Signal Integrity Metrics (Fast 1100mv 0c Model) ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; red[0] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.121 V ; 0.326 V ; 0.297 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.121 V ; 0.326 V ; 0.297 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ;
; red[1] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; red[2] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; red[3] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; red[4] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.119 V ; 0.326 V ; 0.298 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.119 V ; 0.326 V ; 0.298 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ;
; red[5] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; red[6] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; red[7] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; green[0] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; green[1] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; green[2] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; green[3] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; green[4] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; green[5] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; green[6] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; green[7] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; blue[0] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.119 V ; 0.326 V ; 0.298 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.119 V ; 0.326 V ; 0.298 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ;
; blue[1] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; blue[2] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; blue[3] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; blue[4] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; blue[5] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; blue[6] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; blue[7] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ; 2.75 V ; 3.54e-06 V ; 2.81 V ; -0.0578 V ; 0.303 V ; 0.28 V ; 2.93e-10 s ; 3.01e-10 s ; No ; No ;
; hor_sync ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.121 V ; 0.326 V ; 0.297 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.121 V ; 0.326 V ; 0.297 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ;
; ver_sync ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ; 2.75 V ; 4.25e-06 V ; 2.9 V ; -0.107 V ; 0.378 V ; 0.16 V ; 2.87e-10 s ; 4.28e-10 s ; No ; No ;
; vga_clk ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.119 V ; 0.326 V ; 0.298 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ; 2.75 V ; 4.14e-06 V ; 2.91 V ; -0.119 V ; 0.326 V ; 0.298 V ; 2.74e-10 s ; 2.8e-10 s ; No ; No ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Signal Integrity Metrics (Fast 1100mv 85c Model) ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; red[0] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0814 V ; 0.36 V ; 0.156 V ; 3e-10 s ; 4.34e-10 s ; No ; No ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0814 V ; 0.36 V ; 0.156 V ; 3e-10 s ; 4.34e-10 s ; No ; No ;
; red[1] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; red[2] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; red[3] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; red[4] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0805 V ; 0.358 V ; 0.156 V ; 3.01e-10 s ; 4.34e-10 s ; No ; No ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0805 V ; 0.358 V ; 0.156 V ; 3.01e-10 s ; 4.34e-10 s ; No ; No ;
; red[5] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; red[6] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; red[7] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; green[0] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; green[1] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; green[2] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; green[3] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; green[4] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; green[5] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; green[6] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; green[7] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; blue[0] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0805 V ; 0.358 V ; 0.156 V ; 3.01e-10 s ; 4.34e-10 s ; No ; No ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0805 V ; 0.358 V ; 0.156 V ; 3.01e-10 s ; 4.34e-10 s ; No ; No ;
; blue[1] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; blue[2] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; blue[3] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; blue[4] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; blue[5] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; blue[6] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; blue[7] ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ; 2.75 V ; 0.000213 V ; 2.79 V ; -0.0324 V ; 0.139 V ; 0.119 V ; 4.42e-10 s ; 4.33e-10 s ; No ; Yes ;
; hor_sync ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0814 V ; 0.36 V ; 0.156 V ; 3e-10 s ; 4.34e-10 s ; No ; No ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0814 V ; 0.36 V ; 0.156 V ; 3e-10 s ; 4.34e-10 s ; No ; No ;
; ver_sync ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ; 2.75 V ; 0.000247 V ; 2.85 V ; -0.0711 V ; 0.204 V ; 0.181 V ; 4.55e-10 s ; 4.49e-10 s ; No ; No ;
; vga_clk ; 2.5 V ; 0 s ; 0 s ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0805 V ; 0.358 V ; 0.156 V ; 3.01e-10 s ; 4.34e-10 s ; No ; No ; 2.75 V ; 0.000242 V ; 2.86 V ; -0.0805 V ; 0.358 V ; 0.156 V ; 3.01e-10 s ; 4.34e-10 s ; No ; No ;
+----------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Setup Transfers ;
+-----------------------------------------------------------------------------+-----------------------------------------------------------------------------+--------------+----------+----------+----------+
; From Clock ; To Clock ; RR Paths ; FR Paths ; RF Paths ; FF Paths ;
+-----------------------------------------------------------------------------+-----------------------------------------------------------------------------+--------------+----------+----------+----------+
; clk ; clk ; > 2147483647 ; 0 ; 0 ; 0 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; clk ; 395 ; 105 ; 0 ; 0 ;
; clk ; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 27 ; 0 ; 0 ; 0 ;
+-----------------------------------------------------------------------------+-----------------------------------------------------------------------------+--------------+----------+----------+----------+
Entries labeled "false path" only account for clock-to-clock false paths and not path-based false paths. As a result, actual path counts may be lower than reported.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Hold Transfers ;
+-----------------------------------------------------------------------------+-----------------------------------------------------------------------------+--------------+----------+----------+----------+
; From Clock ; To Clock ; RR Paths ; FR Paths ; RF Paths ; FF Paths ;
+-----------------------------------------------------------------------------+-----------------------------------------------------------------------------+--------------+----------+----------+----------+
; clk ; clk ; > 2147483647 ; 0 ; 0 ; 0 ;
; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; clk ; 395 ; 105 ; 0 ; 0 ;
; clk ; game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] ; 27 ; 0 ; 0 ; 0 ;
+-----------------------------------------------------------------------------+-----------------------------------------------------------------------------+--------------+----------+----------+----------+
Entries labeled "false path" only account for clock-to-clock false paths and not path-based false paths. As a result, actual path counts may be lower than reported.
---------------
; Report TCCS ;
---------------
No dedicated SERDES Transmitter circuitry present in device or used in design
---------------
; Report RSKM ;
---------------
No non-DPA dedicated SERDES Receiver circuitry present in device or used in design
+------------------------------------------------+
; Unconstrained Paths ;
+---------------------------------+-------+------+
; Property ; Setup ; Hold ;
+---------------------------------+-------+------+
; Illegal Clocks ; 0 ; 0 ;
; Unconstrained Clocks ; 0 ; 0 ;
; Unconstrained Input Ports ; 4 ; 4 ;
; Unconstrained Input Port Paths ; 148 ; 148 ;
; Unconstrained Output Ports ; 27 ; 27 ;
; Unconstrained Output Port Paths ; 39 ; 39 ;
+---------------------------------+-------+------+
+------------------------------------+
; TimeQuest Timing Analyzer Messages ;
+------------------------------------+
Info: *******************************************************************
Info: Running Quartus II 64-Bit TimeQuest Timing Analyzer
Info: Version 13.1.0 Build 162 10/23/2013 SJ Web Edition
Info: Processing started: Sat May 25 01:40:22 2019
Info: Command: quartus_sta fakequidditch -c fakequidditch
Info: qsta_default_script.tcl version: #1
Info (11104): Parallel Compilation has detected 4 hyper-threaded processors. However, the extra hyper-threaded processors will not be used by default. Parallel Compilation will use 2 of the 2 physical processors detected instead.
Info (21077): Low junction temperature is 0 degrees C
Info (21077): High junction temperature is 85 degrees C
Warning (335093): TimeQuest Timing Analyzer is analyzing 12 combinational loops as latches.
Critical Warning (332012): Synopsys Design Constraints File file not found: 'fakequidditch.sdc'. A Synopsys Design Constraints File is required by the TimeQuest Timing Analyzer to get proper timing constraints. Without it, the Compiler will not properly optimize the design.
Info (332142): No user constrained base clocks found in the design. Calling "derive_clocks -period 1.0"
Info (332105): Deriving Clocks
Info (332105): create_clock -period 1.000 -name clk clk
Info (332105): create_clock -period 1.000 -name game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4] game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332143): No user constrained clock uncertainty found in the design. Calling "derive_clock_uncertainty"
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Info: Found TIMEQUEST_REPORT_SCRIPT_INCLUDE_DEFAULT_ANALYSIS = ON
Info: Analyzing Slow 1100mV 85C Model
Critical Warning (332148): Timing requirements not met
Info (11105): For recommendations on closing timing, run Report Timing Closure Recommendations in the TimeQuest Timing Analyzer.
Info (332146): Worst-case setup slack is -16.105
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -16.105 -1932.832 clk
Info (332119): -5.520 -57.324 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332146): Worst-case hold slack is -0.882
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -0.882 -24.348 clk
Info (332119): 3.633 0.000 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332146): Worst-case minimum pulse width slack is -0.394
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -0.394 -169.274 clk
Info (332119): 0.092 0.000 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info: Analyzing Slow 1100mV 0C Model
Info (334003): Started post-fitting delay annotation
Warning (334000): Timing characteristics of device 5CSEMA5F31C6 are preliminary
Info (334004): Delay annotation completed successfully
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Critical Warning (332148): Timing requirements not met
Info (11105): For recommendations on closing timing, run Report Timing Closure Recommendations in the TimeQuest Timing Analyzer.
Info (332146): Worst-case setup slack is -16.381
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -16.381 -1933.068 clk
Info (332119): -5.642 -58.283 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332146): Worst-case hold slack is -0.978
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -0.978 -26.480 clk
Info (332119): 3.650 0.000 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332146): Worst-case minimum pulse width slack is -0.394
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -0.394 -187.268 clk
Info (332119): 0.099 0.000 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info: Analyzing Fast 1100mV 85C Model
Info (334003): Started post-fitting delay annotation
Warning (334000): Timing characteristics of device 5CSEMA5F31C6 are preliminary
Info (334004): Delay annotation completed successfully
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Critical Warning (332148): Timing requirements not met
Info (11105): For recommendations on closing timing, run Report Timing Closure Recommendations in the TimeQuest Timing Analyzer.
Info (332146): Worst-case setup slack is -9.221
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -9.221 -988.400 clk
Info (332119): -2.732 -26.176 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332146): Worst-case hold slack is -0.451
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -0.451 -6.894 clk
Info (332119): 1.955 0.000 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332146): Worst-case minimum pulse width slack is -0.088
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -0.088 -26.697 clk
Info (332119): 0.176 0.000 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info: Analyzing Fast 1100mV 0C Model
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Critical Warning (332148): Timing requirements not met
Info (11105): For recommendations on closing timing, run Report Timing Closure Recommendations in the TimeQuest Timing Analyzer.
Info (332146): Worst-case setup slack is -8.531
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -8.531 -896.761 clk
Info (332119): -2.586 -24.703 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332146): Worst-case hold slack is -0.544
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -0.544 -8.587 clk
Info (332119): 1.894 0.000 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332146): Worst-case minimum pulse width slack is -0.089
Info (332119): Slack End Point TNS Clock
Info (332119): ========= =================== =====================
Info (332119): -0.089 -26.949 clk
Info (332119): 0.224 0.000 game_controller:game_ctrl|ball_controller_cansu:ball_ctrl|ball_dir_state[4]
Info (332102): Design is not fully constrained for setup requirements
Info (332102): Design is not fully constrained for hold requirements
Info: Quartus II 64-Bit TimeQuest Timing Analyzer was successful. 0 errors, 8 warnings
Info: Peak virtual memory: 5103 megabytes
Info: Processing ended: Sat May 25 01:40:48 2019
Info: Elapsed time: 00:00:26
Info: Total CPU time (on all processors): 00:00:36